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[单选题]

●设某流水线计算机主存的读/写时间为100ns,有一个指令和数据合一的Cache,已知该Cache的读/写时间为10ns,取指令的命中率为98%,取数的命中率为95%。在执行某类程序时,约有1/5指令需要存/取一个操作数。假设指令流水线在任何时候都不阻塞,则设置Cache后,每条指令的平均访存时间约为 (14) 。(14)

A.12ns

B.15 ns

C.18 ns

D.120ns

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第1题
设某计算机有一个指令和数据合一的cache.已知cache的读写时间为10ns,主存的读写时间为100ns,取指的命中率为98%.数据的命中率为95%,在执行程序时,约有1/5指令需要取一个数据,并假设流水线从不阻塞,问设置cache后,与无cache比较,计算机的运算速度可提高到多少倍?

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第2题
假设机器周期为10ns,cache访问时间为1个周期,主存访问时间是20个周期。(1)设命中率为95%,求平均访存时间。(2)如果cache容量增加一倍而使命中率提高到97%,然面因此而使机器周期延长到12ns,这样的改动方案是否值得采取?

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第3题
判断以下有关cache的叙述的正确性,如果错误,请纠正。(1)cache命中时.由硬件完成存/取操作,不命
判断以下有关cache的叙述的正确性,如果错误,请纠正。

(1)cache命中时.由硬件完成存/取操作,不命中时由操作系统处理。

(2)cache与主存统一编址,即根据地址不同,访问主存或cache.

(3)在主机中,cache可由SRAM或DRAM组成。

(4)cache的容量一般与主存相差不多。

(5)cache主要是为了扩充存储器容量。

(6)在大多数程序执行过程中.指令的命中率小于数据的命中率。

(7)cache中的内容是主存的一个小副本,因此在大多数计算机中,在任何时候cache与主存都能保持一致性。

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第4题
有二个处理机P1和P2,它们各自有一个cache和主存,分别为C1、C2和M1、M2,其性能见下表:若两个处理机
有二个处理机P1和P2,它们各自有一个cache和主存,分别为C1、C2和M1、M2,其性能见下表:

若两个处理机的指令系统相同,指令的执行时间与存储器的平均存取周期成正比,当执行某程序时,cache的命中率为70%,则P1处理机的速度比P2处理机()。

A.更快

B.更慢

C.相等

D.不能确定

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第5题
在CPU执行一段程序的过程中,Cache的存取次数为1900次,由主存完成的存取次数为 100次。若Cache的存
取厨期为5ns,主存的存取周期为25ns,则Cache的命中率为(276)CPU的平均访问时间为(277)ns。

A.0.93

B.0.95

C.0.97

D.0.99

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第6题
CPU执行一段程序时,cache完成存取的次数为1900次,主存完成存取的次数为100次,已知cache存取周期为50ns,主存存取周期为250ns,问:(1)cache/主存系统的效率是多少;(2)平均访问时间是多少;

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第7题
在CPU执行一段程序的过程中,Cache的存取次数为3800次,由主存完成的存取次数为200次。若Cache的存
取周期为5ns,主存的存取周期为25ns,则Cache的命中率为(1);CPU的平均访问时间为(2)ns。

A.0.93

B.0.95

C.0.97

D.0.99

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第8题
若主存读写时间为30ns,高速缓存的读写时间为3ns,平均读写时间为3.27ns,则该高速缓存的命中率为()%。

A.90

B.95

C.97

D.99

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第9题
高速缓存Cache与主存间采用全相联地址映像方式,高速缓存的容量为4MB,分为 4块,每块1MB,主存容量
为256MB。若主存读写时间为30ns,高速缓存的读写时间为 3ns,平均读写时间为3.27ns,则该高速缓存的命中率为(1)%。若地址变换表如下所示,则主存地址为8888888H时,高速缓存地址为(2)H。

A.90

B.95

C.97

D.99

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