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[主观题]

某计算机的主存地址空间中,从地址0000H~3FFFH为ROM存储区域,从地址 4000H~7FFFH为RAM的存储

某计算机的主存地址空间中,从地址0000H~3FFFH为ROM存储区域,从地址

某计算机的主存地址空间中,从地址0000H~3FFFH为ROM存储区域,从地址 4000H~7FFF4000H~7FFFH为RAM的存储区域。RAM的控制信号为CS和WE,CPU的地址线为A15~A0,数据线为8位的D7~D0线,控制信号有读写控制R/W和访存请求MREQ,要求: (1)画出地址译码方案。 (2)如果ROM和RAM存储器芯片都采用8 K×1位的芯片,试画出存储器与CPU的连接图。 (3)如果ROM存储器芯片采用8K×8位的芯片,RAM存储器芯片采用4K×8位的芯片, 试画出存储器与CPU的连接图。 (4)如果ROM存储器芯片采用16K×8位的芯片,RAM存储器芯片采用8K×8位的芯片,试画出存储器与CPU的连接图。

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第1题
用64K×8的RAM芯片和32K×16的ROM芯片设计一个256K×16的存储器,地址范围为00000H~3FFFFH,其中ROM的
地址范围为10000H~1FFFFH,其余为RAM的地址。则地址线为(1)根,数据线为(2)根;ROM需要(3)片,RAM需要(4)片。

CPU执行一段程序时,Cache完成存取的次数为5000次,主存完成存取的次数为200次。已知Cache的存取周期为40ns,主存的存取周期为160ns。其两级存储器的平均访问时间为(5)ns。

A.18

B.9

C.16

D.8

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第2题
设CPU共有16根地址线,8根数据线,并用MREQ作访存控制信号(低电平有效),用WR作读写控制信号(高
设CPU共有16根地址线,8根数据线,并用MREQ作访存控制信号(低电平有效),用WR作读写控制信号(高电平为读,低电平为写)。现有下列存储芯片:1K×4位RAM,4K×8位RAM,2K×8位ROM,以及74138译码器和各种门电路,如图所示。画出CPU与存储器连接图,要求:1.主存地址空间分配:8000H~87FFH为系统程序区;8800H~8BFFH为用户程序区。

2.合理选用上述存储芯片,说明各选几片?

3.详细画出存储芯片的片选逻辑。

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第3题
某计算机主存容量为64KB,其中ROM区为4KB,其余为RAM区,按字节编址。现要用2K×8位的ROM芯片和4K×4位
的RAM芯片来设计该存储器,则需要上述规格的ROM芯片数和RAM芯片数分别是

A.1、15

B.2、15

C.1、30

D.2、30

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第4题
用16k×8位的SRAM芯片构成64K×16位的存储器,要求画出该存储器的组成逻辑框图。存储器容量为64K
×16位,其地址线为16位(A15—A0),数据线也是16位(D15—D0)SRAM芯片容量为16K×8位,其地址线为14位,数据线为8位,因此组成存储器时须字位同时扩展。

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第5题
如果某存储器芯片共有20根地址线的引脚,则该存储器芯片的存储容量为()。

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第6题
设某静态RAM芯片容量为8KX8位,若用它组成32K×8位的存储器,所用芯片数以及这种芯片的片内地址线数
目是()。

A.4片、13根

B.4片、12根

C.6片、11根

D.4片、16根

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第7题
设CPU共有16根地址线,8根数据线,并用作访存控制信号(低电平有效),用作读写控制信号(高电平为
设CPU共有16根地址线,8根数据线,并用作访存控制信号(低电平有效),用作读写控制信号(高电平为读,低电平为写)。现有下列芯片及各种门电路(门电路自定),如图所示。

画出CPU与存储器的连接图,要求:1.存储芯片地址空间分配为:0~2047为系统程序区;2048~8191为用户程序区。2.指出选用的存储芯片类型及数量;3.详细画出片选逻辑

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第8题
某静态RAM 芯片容量为8K×8位,如用它组成32K×8位的存储器,所用芯片数及这种芯片的片内地址线数目
是()。

A.4片、13根

B.4片、12根

C.6片、11根

D.4片、16根

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第9题
设用2K×4位的存储器芯片组成16K x 8位的存储器(地址单元为0000H~3FFFH,每个芯片的地址空间连续),则地址单元OBlFH所在芯片的最小地址编号为(4)。

A.0000H

B.0800H

C.2000H

D.2800H

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